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  • Número do documento: 123456
  • Code Name: Emerald Rapids
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FPGA de baixo consumo Cyclone® 10

O FPGA de baixo consumo Cyclone® 10 amplia a liderança da série de FPGAs Cyclone em dispositivos de baixo consumo direcionados para aplicações de alto volume e sensíveis a custos.

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Ideal para aplicativos de alto volume e sensíveis ao custo

Benefícios

Metade da energia com metade do custo1

Ideal para funções de alto volume e sensíveis a custos, o FPGA de baixo consumo Cyclone 10 foi projetado para um amplo espectro e se adequa a aplicações finais inteligentes e conectadas em muitos segmentos de mercado.

Reduza seus custos de sistema

Todos os FPGAs de baixo consumo Cyclone 10 exigem apenas duas fontes de alimentação de núcleo para operação, simplificando a sua rede de distribuição de energia e economizando custos de placa, o espaço na placa e o tempo do projeto. Isso permite projetar um sistema de custos mais baixos.

Reduz o consumo de energia

Baseados em um processo de 60 nm com otimização de consumo, o FPGA de baixo consumo Cyclone 10 amplia a liderança de baixo consumo do FPGA de baixo consumo Cyclone V da geração anterior. Os dispositivos de última geração reduzem o consumo estático do núcleo em até 50% em comparação com as gerações anteriores.

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Aplicativos

Sistemas embarcados

Os crescentes requisitos de desempenho dos sistemas embarcados atuais estão orientando a seleção de microprocessadores. Os FPGAs de baixo consumo Cyclone 10 são ideais para essas aplicações. Com uma variedade de blocos de propriedade intelectual (IP), como I2C, serial peripheral interface (SPI), UART, blocos de E/S paralelos e pacotes com suporte para mais de 500 E/S, os projetistas podem escalar para atender às necessidades do aplicativo.

Interface de chip para chip

Os FPGAs de baixo consumo Cyclone 10 são uma solução ideal para a interface entre produtos padrão específicos de aplicativos (ASSPs). Esses dispositivos permitem que os projetistas combinem a interface com o processamento de pipeline de imagens para aplicativos em tempo real que precisam de altas taxas de quadros, baixa latência e alto rendimento de processamento.

Controle de motor

Estas FPGAs oferecem flexibilidade para interfaceamento de uso geral com uma contagem máxima de E/S de até 525 E/S de usuário, ao mesmo tempo que suportam as diversas necessidades de unidades do cliente. Esses dispositivos suportam uma ampla variedade de protocolos Ethernet industriais, sendo aproveitados para implementar o modulador de largura de pulso (PWM) e as interfaces de codificador, que, quando repetidas várias vezes em paralelo, permitem o controle de vários eixos.

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Recursos principais

Multiplicadores embarcados

Cada bloco de multiplicador embarcado nos dispositivos suporta um multiplicador individual de 18 × 18 bits ou dois multiplicadores individuais de 9 × 9 bits. Blocos de multiplicadores em cascata para formar estruturas lógicas mais amplas ou mais profundas.

Elementos lógicos e blocos de matriz lógica

O bloco de matriz lógica (LAB) consiste em 16 elementos lógicos (LEs), cada um com quatro entradas, uma tabela de pesquisa de quatro entradas (LUT), um registro e uma lógica de saída. A LUT de quatro entradas é um gerador de funções que pode implementar qualquer função com quatro variáveis.

Blocos de memória embarcados

A estrutura de memória embarcada consiste em colunas de blocos de memória M9K. Cada bloco de memória M9K do dispositivo fornece 9 Kb de memória no chip.

Transtorno de evento único (SEU)

O recurso de detecção de erros de verificação de redundância cíclica (CRC) pode verificar um SEU continuamente, confirmando automaticamente a precisão dos dados de configuração armazenados no dispositivo e alertando o sistema sobre a ocorrência de um erro de configuração.

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Links relacionados

Visão geral do componente de baixo consumo Cyclone® 10

Ficha técnica do Cyclone® 10

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