FPGA Intel® Cyclone® 10 LP
A família do FPGA de baixo consumo Intel® Cyclone® 10 amplia a liderança dos FPGAs da série Intel® Cyclone® em dispositivos de baixo custo e baixa potência. Ideal para funções de alto volume sensíveis ao custo, os FPGAs de baixo consumo Intel® Cyclone® 10 são projetados para um amplo espectro de aplicações gerais de lógica.
Consulte também: software de projeto, loja de projetos, downloads, comunidade e suporte para o FPGA
FPGA Intel® Cyclone® 10 LP
Arquitetura
O mar de portas da malha central de lógica e roteamento é cercado em cada lado por elementos de E/S, com uma malha de captura de fase (PLL) em cada canto. Blocos de memória embarcada (M9K) e blocos de multiplicadores de 18 x 18 bits são dispostos em colunas verticais.
A arquitetura também inclui redes altamente eficientes de interconexão e de clock de baixa distorção, fornecendo conectividade entre estruturas lógicas para o sinal de clock e de dados.
Transtorno de evento único (SEU)
A detecção de erros de configuração é suportada em todos os dispositivos de baixo consumo Intel® Cyclone® 10. A detecção de erros em modo de usuário é suportada apenas em dispositivos com tensão do núcleo de 1,2 V. Circuitos dedicados integrados nos dispositivos de baixo consumo Intel® Cyclone® 10 consistem em um recurso de detecção de erros de CRC que pode verificar opcionalmente transtornos de evento único (SEU) de forma contínua ou automática.
Em aplicações críticas usadas nos campos de aviônica, telecomunicações, controle de sistemas, medicina e aplicações militares, é importante poder:
- Confirmar a precisão dos dados de configuração armazenados em um dispositivo FPGA.
- Alertar o sistema sobre a ocorrência de um erro de configuração.
Processador Nios® II
Nios® II, o processador sem royalties mais versátil do mundo de acordo com a pesquisa da Gartner, é o processador softcore mais amplamente usado no setor de FPGAs. O processador Nios II oferece flexibilidade sem precedentes para suas necessidades de processamento de aplicativos com sensibilidade de custo, em tempo real, críticos para segurança (DO-254) e otimizados para ASIC.
A família do processador Nios II consiste em dois núcleos configuráveis com arquitetura Harvard de 32 bits:
- Rápido (núcleo /f): pipeline de seis estágios otimizado para desempenho máximo, unidade de gerenciamento de memória (MMU) ou unidade de proteção de memória (MPU) opcionais.
- Econômico (núcleo /e): otimizado para ter o menor tamanho e disponível sem qualquer custo (uma licença não é necessária).
Precisa aumentar o desempenho? Sem problemas. A aceleração de hardware é tão fácil como usar a lógica programável de um FPGA para descarregar e acelerar tarefas que são normalmente implementadas em um software de aplicativo. Saiba mais na página do processador Nios® II.
Para obter mais informações sobre ferramentas de desenvolvimento de software gratuitas, acesse a página Ferramentas de desenvolvimento do processador Nios® II.
Para o treinamento do processador Nios II, acesse a página Intel® FPGA Technical Training.
Desempenho do processador Nios® II (DMIPS em Fmax)
Nota: parâmetro de referência Dhrystone 2.1 (estimativa da Intel)
Variante | Desempenho (DMIPS) |
---|---|
Nios II/e Econômico | 30 a 175 MHz |
Nios II/f Rápido |
190 a 165 MHz |
Aplicativos para o processador Nios® II
Aplicativo |
Núcleo do processador Nios® II |
Fornecedor |
Descrição |
---|---|---|---|
Potência e custo acessível |
Núcleo econômico Nios II |
Intel® |
Com apenas 600 elementos lógicos, o núcleo econômico do processador Nios II é ideal para aplicações de microcontroladores. O núcleo econômico do processador Nios II, ferramentas de software e drivers de dispositivos são oferecidos gratuitamente. |
Tempo real |
Núcleo rápido Nios® II |
Intel® |
Desempenho em tempo real absolutamente determinístico livre de jitter com as seguintes opções de recursos de hardware em tempo real exclusivos
|
Processamento de aplicações |
Núcleo rápido Nios® II |
Intel® |
Com opção de configuração simples, o núcleo rápido do processador Nios II pode usar a unidade de gerenciamento de memória (MMU) para executar o Linux* embarcado. Tanto as versões de código aberto quanto as suportadas comercialmente do Linux para os processadores Nios II estão disponíveis. |
Essencial para segurança |
Núcleo Nios® II SC |
HCELL |
Certifique seu projeto para conformidade ao DO-254 usando o núcleo de processador Nios® II Safety Critical juntamente com os serviços de projeto de conformidade ao DO-254 oferecidos pela HCELL. |
Lockstep de dois núcleos |
fRSmartComp IP |
Yogitech |
A solução lockstep oferece diagnóstico de alta cobertura, autoverificação e recursos de diagnóstico avançados em total conformidade com os padrões de segurança funcional IEC 61508 e ISO 26262, enquanto reduz a necessidade de bibliotecas de teste de software de diagnóstico difíceis de desenvolver e que enfraquecem o desempenho. |
A detecção de erros de configuração é suportada em todos os dispositivos de baixo consumo Intel® Cyclone® 10. A detecção de erros em modo de usuário é suportada apenas em dispositivos com tensão do núcleo de 1,2 V. Circuitos dedicados integrados nos dispositivos de baixo consumo Cyclone 10 consistem em um recurso de detecção de erros de CRC que pode verificar opcionalmente transtornos de evento único (SEU) de forma contínua ou automática.
Em aplicações críticas usadas nos campos de aviônica, telecomunicações, controle de sistemas, medicina e aplicações militares, é importante poder:
- Confirmar a precisão dos dados de configuração armazenados em um dispositivo FPGA.
- Alertar o sistema sobre a ocorrência de um erro de configuração.
Qualificação e certificação
Os FPGAs de baixo consumo Intel® Cyclone® 10 são oferecidos em níveis de temperatura comercial, industrial e automotivo (AEC-Q100).
Além disso, serão suportados em uma versão futura do pacote de segurança funcional, com certificado TUV para IEC 61508, reduzindo o tempo de desenvolvimento e de comercialização.
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