FPGA Cyclone® V E
O FPGA Cyclone® V E é otimizado para baixo custo de sistema e consumo de energia para um amplo espectro de aplicações gerais de lógica e DSP.
FPGA Cyclone® V E
Benefícios
Faça mais com menos energia, tempo de projeto e custo
Construído com a tecnologia de processo de 28 nm de baixa potência (28LP) da TSMC, incluindo uma abundância de blocos de Hard IP, permitindo que você se diferencie e faça mais.
Integração lógica e recursos de diferenciação
Ele oferece um módulo de lógica adaptativa (ALM) de 8 entradas e blocos de processamento de sinal digital (DSP) de precisão variável, permitindo até 13,59 megabits (Mb) de memória embarcada.
Menor custo do sistema
A operação requer apenas duas tensões de núcleo e está disponível em embalagens de ligação por fio de baixo custo. Inclui recursos inovadores, como Configuração via protocolo (CvP) e reconfiguração parcial.
Aplicativos
Industrial: movimentos de dispositivo único e controle de motor
Suporta controle de alta precisão por meio do controle de movimento multi-xis com alto desempenho da aceleração de hardware em comparação com drivers de software. A integração de protocolos (Ethernet industrial e fieldbus) e lógica de controle aumenta a confiabilidade, minimiza o footprint e reduz o custo.
Aplicações militares
Projetado para atender aos requisitos de SWaP. Prolonga a autonomia da bateria, capacidade de operar em ambientes com restrição térmica, menos componentes de suporte e pacotes compactos. Conjunto de segurança abrangente, incluindo proteção de porta JTAG, criptografia de AES volátil e não volátil de 256 bits, circuitos de detecção de erros e ID exclusiva.
Militar: óculos de visão noturna
Economize energia com a queda de blocos de Hard IP nãoutilizados. Suporte para LPDDR2 em controlador de memória física. Economia de custos com blocos DSP para processamento de vídeo eficiente. O pacote de Processamento de Vídeo e Imagem (IP) totalmente testado e verificado permite que você se concentre em diferentes recursos.
Recursos principais
Blocos de memória internos
- M10K: blocos de memória de 10 kilobits (Kb) com código soft de correção de erros (ECC).
- Bloco de matriz lógica de memória (MLAB): LUTRAM distribuída de 640 bits, onde você pode usar até 25% dos ALMs como memória MLAB.
E/Ss de uso geral
- Receptor de sinalização diferencial de baixa tensão (LVDS) de 875 megabits por segundo (Mbps) e transmissor LVDS de 840 Mbps.
- Interface de memória externa de 400 MHz/800 Mbps.
- Terminação em chip (OCT).
- Suporte para 3,3 V com força de acionamento de até 16 mA.
Blocos DSP de precisão variável
DSP de precisão variável: suporte nativo para até três níveis de precisão de processamento de sinal no mesmo bloco de DSP de precisão variável, acumulador de 64 bits e cascata.
Blocos de Hard IP embarcados
- Suporte até dois controladores de memória física para dispositivos DDR3, DDR2 e LPDDR2 SDRAM.
- Cada controlador suporta componentes de 8 a 32 bits de até 4 gigabits (Gb) em densidade com dois chip selects e ECC opcional.
Recursos adicionais
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Recursos de suporte técnico
Centro de recursos para treinamento, documentação, downloads, ferramentas e opções de suporte.
Placas de desenvolvimento
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Propriedade Intelectual
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Design de software FPGA
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