FPGA SoC Cyclone® V SE
Cyclone® V SE FPGA é otimizado para baixo custo de sistema e consumo de energia com sistema de processador ARM® Cortex-A9® MPCore integrado para aplicações de transceptor de 614 Mbps a 3,125 Gbps.
FPGA SoC Cyclone® V SE
Benefícios
Faça mais com menos energia, tempo de projeto e custo
Construído com a tecnologia de processo de 28 nm de baixa potência (28LP) da TSMC, incluindo uma abundância de blocos de Hard IP, permitindo que você se diferencie e faça mais.
Integração lógica e recursos de diferenciação
Ele oferece um módulo de lógica adaptativa (ALM) de 8 entradas e blocos de processamento de sinal digital (DSP) de precisão variável, permitindo até 13,59 megabits (Mb) de memória embarcada.
Hard processor system (HPS) com processador Arm® Cortex-A9® MPCore integrado
Integração estreita de um processador dual-core Arm® Cortex-A9® MPCore, hard IP e um FPGA em um único sistema em um chip (SoC) Cyclone® V. Ela suporta largura de banda de pico de mais de 128 Gbps com coerência de dados integrada entre o processador e a malha de FPGA.
Aplicativos
Eficiência energética para unidades da próxima geração
Atende aos requisitos de complexidade e desempenho: loops de controle rápidos; DSP e desempenho computacional, suportam vários protocolos Ethernet industriais (IE), escalabilidade para controle de vários machados e sistemas de acionamento integrados. Melhora o tempo de comercialização por meio da escalabilidade, flexibilidade e reutilização de hardware e projeto, e oferece suporte ao IP de segurança funcional e ao fluxo de ferramentas: economiza até 24 meses no processo de Certificação de Segurança.
Vigilância de circuito fechado por IP
Capaz de lidar com a interface do sensor (glueless para conectividade paralela ou serial de alta velocidade), todo o pipeline do sensor de imagem ou ISP, o processamento de imagem exclusivo para sensores de CMOS de ampla faixa dinâmica, controle de motor otimizado para pan & tilt, compressão de vídeo em chip, escalonamento, análises, controladores Ethernet e a capacidade de se conectar a codificadores off-chip ou dispositivos PHY para a transmissão, Mercados de câmeras analógicas ou IP.
Câmera IP de alta definição (HD)
Câmeras HD IP de geração futura para trazer a integração do DSP (processamento de imagem) e FPGA (análise de vídeo HD) para um único chip SoC FPGA que fornece análise de vídeo HD 1080p com ampla faixa dinâmica. A análise de vídeo HD pode ser executada em um dos núcleos arm com lógica adicional na malha FPGA. Neste caso, a Ampla Faixa Dinâmica é adicionada ao processamento de sinal de imagem no FPGA SoC.
Recursos principais
Blocos de memória embarcados
- M10K: blocos de memória de 10 kilobits (Kb) com código soft de correção de erros (ECC).
- Bloco de matriz lógica de memória (MLAB): LUTRAM distribuída de 640 bits, onde você pode usar até 25% dos ALMs como memória MLAB.
E/Ss de uso geral
- Receptor de sinalização diferencial de baixa tensão (LVDS) de 875 megabits por segundo (Mbps) e transmissor LVDS de 840 Mbps.
- Interface de memória externa de 400 MHz/800 Mbps.
- Terminação em chip (OCT).
- Suporte para 3,3 V com força de acionamento de até 16 mA.
Interface de memória externa
Nos dispositivos SoC Cyclone® V, um controlador de memória física adicional no HPS suporta dispositivos DDR3, DDR2 e LPDDR2 SDRAM.
Hard Processor System (HPS)
O HPS consiste em um processador dual-core Arm* Cortex* -A9 MPCore*, um conjunto rico de periféricos e um controlador de memória SDRAM multiportas compartilhado.
Recursos adicionais
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Recursos de suporte técnico
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