LDPC Intel® FPGA IP
A Intel está descontinuando a propriedade intelectual (IP) para LDPC, mais informações podem ser encontradas na notificação de descontinuação de produto (PDN2208).
LDPC Intel® FPGA IP
Verificação de paridade de baixa densidade de 5G
Os códigos de verificação de paridade de baixa densidade (LDPC) são códigos de correção de erro linear que permitem transmitir mensagens em canais ruidosos. O núcleo de propriedade intelectual (IP) de verificação de paridade de baixa densidade de 5G do Intel FPGA é um codificador ou decodificador de alta taxa de transferência que está em conformidade com a especificação de 5G do 3rd Generation Partnership Project (3GPP - projeto de parceria para a terceira geração). Os códigos LDPC oferecem melhor eficiência espectral e suportam a alta taxa de transferência para o novo rádio (NR) 5G. Com a flexibilidade dos FPGAs Intel, diversas configurações podem ser projetadas e implementadas e reprojetadas para suportar quaisquer mudanças no gráfico base, na taxa de código, Z e largura de LR.
Recursos
DOCSIS 3.1 |
Decodificador Comutação em tempo real entre código |
---|---|
WiMedia 1.5 |
Codificador/decodificador Comprimento de palavra de código variável Comutação em tempo real entre código opcional Suporte para frame curto e longo |
DVB-S2 |
Codificador |
NASA |
Codificador/decodificador (compatível com CCSDS) Arquitetura de poucos recursos opcional disponível Decodificação MSA ou MSA em camadas |
Modelos com precisão de bits MATLAB* para simulação |
Todos os decodificadores possuem:
- Modelos MATLAB
- Arquitetura de buffer duplo para reduzir a latência e aumentar a taxa de transferência
- Critério de parada precoce
- Parâmetros para:
- Paralelismo de entrada
- Paralelismo de decodificação
- Largura LLR
- Fator de atenuação
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