10GBASE-R PHY Intel® FPGA IP
O núcleo 10GBASE-R PHY Intel® FPGA IP permite conectividade direta com qualquer módulo óptico XFP ou SFP+ ou com qualquer dispositivo externo com interfaces XFI e SFI.
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10GBASE-R PHY Intel® FPGA IP
O núcleo PHY IP pode ser usado com Intel® FPGA IP para MAC Ethernet 10 G ou com um MAC Ethernet desenvolvido pelo cliente por meio de uma interface XGMII padrão em execução a 156,25 Mbps.
Este núcleo PHY IP é disponibilizado como parte da funcionalidade do transceptor dos Intel® FPGAs.
Recursos
- PHY consistindo de subcamada de codificação física (PCS) de 10GBASE-R, conexão de meio físico (PMA) de 10,3125 Gbps, e funções de gerenciamento PHY.
- Interface direta com o MAC 10 GbE para uma solução completa de chip único.
- PHY integrado em silício rígido nos FPGAs Intel® Arria® 10, Stratix® V e Arria® V GZ com transceptores seriais de 10,3125 Gbps. O PCS Soft 10GBASE-R também está disponível nos FPGAs Stratix® IV GT e Arria® V (GT e ST).
- Conexão serial direta de 10,3125 Gbps para chip a chip, chip a módulo óptico, chip a dispositivo PHY e aplicativos de backplane.
- Suporte de E/S reconfigurável parcial (DPRIO) em transceptores seriais para adaptação a várias características do canal e dispositivos de 10GBASE-R nos sistemas durante a operação.
- Implementação da função PHY padrão Ethernet 10GBASE-R: codificação ou decodificação de 64 b/66 b, codificação/descodificação, taxa de receptor para compensação de frequência de clock, boxe de velocidade de 66b/16b e serialização ou desserialização de dados de e para a linha de 10,3125 Gbps.
- Detecção do status de falha do receptor.
- Loop-back serial local do transmissor para o receptor no transceptor serial para testes.
- Opção IEEE 1588 v2 para gravação do tempo de alta precisão e exatidão.
- Interfaces do sistema interno de alto desempenho
- Taxa de dados única (SDR) Intel® FPGA Avalon® Streaming (Avalon-ST) XGMII, 72 bits a 156,25 Mbps para transferência de dados
- Intel® FPGA Avalon® Memory-Mapped (Avalon-MM) de 32 bits para gerenciamento de subordinados
- Conformidade padrão IEEE 802.3 10 GbE, cláusulas 46, 49 e 51.
- Testes de validação de Interoperabilidade da Universidade de New Hampshire (UNH-IOL) Ethernet MAC e PCs de 10 Gbps.
Métricas de qualidade IP
Básico |
|
---|---|
Ano em que o IP foi lançado |
2015 |
Suporte para a primeira versão do Software Intel Quartus Prime |
16,1 |
Códigos de pedidos |
IP-10GMRPHY: Intel Arria 10 IP-10GBASERPCS: série Cyclone V IP-10GMRPHY: Intel Cyclone10 IP-10GETHMAC: MAC MegaCore Ethernet de 10 Gbps |
Status |
Produção |
Resultados |
|
Os resultados do cliente incluem o seguinte: Arquivo de projeto (código de fonte criptografado ou netlist pós-síntese) Modelo de simulação para ModelSim* — Edição Intel FPGA Restrições de cronograma e/ou de layout Documentação com controle de revisão Arquivo readme |
Y |
Quaisquer resultados de clientes adicionais fornecidos com IP |
|
GUI de parametrização permitindo que o usuário final configure o IP |
Y |
O núcleo de IP está habilitado para o suporte ao Intel FPGA IP Evaluation Mode |
Y |
Idioma da fonte |
Verilog |
Linguagem do banco de testes |
|
Drivers do software fornecidos |
N |
Suporte do SO do driver |
|
Implementação |
|
Interface do usuário |
Taxa de dados única XGMII / GMII / GMII de 16 Bits (caminho de dados), Avalon-MM (gerenciamento) |
Metadados IP-XACT |
N |
Verificação |
|
Simuladores suportados |
Mentor Graphics*, Synopsys*, Cadence* |
Hardware validados |
Intel Stratix 10, Intel Arria 10 |
Testes de conformidade padrão do setor realizados |
Y |
Em caso afirmativo, quais testes? |
46, 49 e 51 |
Em caso afirmativo, em quais dispositivos Intel FPGA? |
|
Em caso afirmativo, a data da realização |
|
Em caso negativo, estão planejados? |
N |
Interoperabilidade |
|
O IP sofreu testes de interoperabilidade |
N |
Em caso afirmativo, em quais dispositivos Intel FPGA? |
|
Relatórios de interoperabilidade disponíveis |
N |
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Documentação
Recursos adicionais
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