QDR II SRAM Controller Intel® FPGA IP Function

O QDR II SRAM Controller Intel FPGA IP oferece uma interface fácil de usar para os módulos QDR II SRAM e QDR II+ SRAM. O controlador QDR II SRAM garante que o posicionamento e o controle do tempo estejam de acordo com as especificações QDR II. A interface local do controlador QDR II SRAM é compatível com a interface Intel FPGA Avalon® Memory-Mapped para fácil integração ao Intel Qsys IP.

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QDR II SRAM Controller Intel® FPGA IP Function

O QDR II SRAM Controller Intel FPGA IP é otimizado para FPGAs séries Stratix® e Cyclone® IV. Os recursos avançados disponíveis nesses dispositivos permitem que você interfaceie diretamente dispositivos QDR II SRAM.

O projeto de exemplo gerado pelo IP Toolbench instancia um Phase-locked loop (PLL), um Delay-locked loop opcional (apenas para FPGAs Stratix II), um driver de exemplo e sua variação personalizada do QDR II SRAM Controller. O exemplo de projeto é totalmente funcional e pode ser simulado, sintetizado e utilizado em hardware. O driver de exemplo é um módulo de autoteste que emite comandos de leitura e gravação para o controlador e verifica os dados de leitura para produzir os sinais de aprovação ou desaprovação e os sinais de teste completo. Você pode substituir a lógica de controle criptografado do QDR II SRAM Controller no projeto de exemplo com sua lógica personalizada, o que permite que você use a ressincronização de texto simples do Intel FPGA e a lógica do pipeline e o caminho de dados com sua própria lógica de controle.

Este IP está incluído no conjunto de base IP que está integrado ao software Intel® Quartus® Prime Standard e Pro Edition.

Recursos

  • Suporte para QDR II e QDR II+ SRAMs
  • Suporte para o burst de dois ou quatro tipos de memória
  • Suporte para interfaces QDR II SRAM de 8 bits, 18 bits e 36 bits
  • Projeto flexível e robusto
  • Suporte para duas vezes e quatro vezes a largura dos dados no lado local (quatro vezes apenas para burst de quatro)
  • Concatenação automática de leituras e gravações consecutivas (apenas no modo de largura estreita de barramento local)
  • Modelos de simulação funcional de Intellectual Property (IP) para uso em simuladores VHDL e Verilog HDL suportados pela Intel
  • Interface IP Toolbench fácil de usar e exemplo de projeto
  • Oferece suporte para o Intel FPGA IP Evaluation Mode

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