ID do artigo: 000074108 Tipo de conteúdo: Solução de problemas Última revisão: 11/09/2012

Qual é a diferença ao migrar designs PCIe de StratixIV para StratixV?

Ambiente

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

Figura 5-2 do compilador IP para PCI Express® Os grupos do Guia do usuário sinalizam em várias categorias. As seguintes listas são de cada categoria e se os sinais dentro de cada categoria foram adicionados, removidos ou alterados ao migrar para Stratix® Dispositivos V.

  

Componente específico: sem mapeamento direto, os sinais neste grupo foram alterados ou removidos.

 

Reset e treinamento de link: sem mapeamento direto dos sinais de redefinição.  Alguns sinais relacionados a redefinições nesta categoria foram adicionados ou removidos.  Além disso, as definições de sinal de redefinição podem ter mudado.

 

Bloco de reconfiguração: esta interface não existe em dispositivos StratixV.

 

Controle do transceptor: permanecem apenas reconfig_fromgxb e reconfig_togxb sinais equivalentes.  Esses dois sinais foram renomeados para reconfig_fromxcvr e reconfig_toxrvr.

 

Config (Configuração da camada de transação): o comportamento desta interface mudou ligeiramente, bem como a definição de hpg_ctrler.

 

Apenas simulação de interface PIPE:

Sinais PIPE não de 8 bits: os sinais de clock foram renomeados e sinais adicionais foram adicionados.

 

Interface de teste: o mapeamento e os bits disponíveis para uso nesta interface foram alterados.

 

Uma descrição completa do sinal individual dentro de cada categoria de sinal pode ser encontrada nos seguintes Guias do Usuário:

Compilador ip para guia de usuário PCI Express

Guia de usuário Hard IP stratixV para PCI Express

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Este artigo aplica-se a 2 produtos

FPGA Stratix® IV GX
FPGA Stratix® V GX

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