ID do artigo: 000074553 Tipo de conteúdo: Solução de problemas Última revisão: 11/09/2012

Por que os valores de tREFI na simulação e na medição da placa são diferentes do que é definido no controlador de memória SDRAM Altmemphy e UniPHY baseado em DDR2?

Ambiente

  • Intel® Quartus® II Subscription Edition
  • Controlador SDRAM LPDDR2 com UniPHY Intel® FPGA IP
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    O resultado do tREFI na simulação e na placa pode ser maior do que o esperado se você definir tREFI a menos de 7,8us em DDR/DDR2/LPDDR2 MegaWizard.

    DDR/DDR2/LPDDR2 SDRAM IP tem um parâmetro MEM_TREFI, que define o parâmetro tREFI em termos de ciclos de clock de memória.

    Como o valor mínimo deste parâmetro é limitado a 780, o tREFI torna-se maior quando o clock de memória é mais lento.

    Por exemplo, o tREFI para SDRAM DDR2 deve ser 3,9us em >85C. Mas se o clock de memória DDR2 for de 125 MHz(8ns), o valor mínimo de tREFI pode ser 8ns x 780 = 6,24us.

    O tREFI para DDR deve ser de 7,8us. Mas se o clock de memória DDR for de 76,9 MHz (13ns), o valor mínimo de tREFI pode ser de 13ns x 780 = 10,14us.

    Resolução

    Como solução alternativa, se o clock de memória DDR estiver abaixo de 100 MHz ou se você definir tREFI como <7.8us na memória DDR2, você pode alterar o parâmetro MEM_TREFI em

    *ddrx_controller_wrapper arquivo *_c0 (IP baseado em Altmemphy) para corrigir o valor tREFI.

    Este problema foi corrigido no software Quartus® II versão 12.0.

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