Devido a um problema nas versões de software Quartus® II 14.1 Update 1 e anterior, você pode ver este erro ao compilar um design Intel® Arria® 10 FPGA contendo um Hard IP para PCI Express (PCIe), onde a lógica é colocada entre o pino nPERST e o Hard IP para PCI Express (PCIe) Intel FPGA IP core.
Remova qualquer lógica colocada entre o pino nPERST e o Hard IP for PCI Express (PCIe) Intel FPGA IP núcleo, pois isso não é suportado.
Esta mensagem de erro está programada para ser aprimorada no software Quartus® II v15.01.