Você poderá ver os avisos críticos no estágio de ajuste, se você implementar mais de um controlador DDR3 UniPHY baseado em NÚCLEOS IP no software Quartus® II versão 10.0 como mestre e escravo.
Você também pode ver outro aviso crítico
Aviso crítico: falha ao encontrar o clock PLL para pinos...
Para remover os avisos críticos, implemente as seguintes etapas:
1. Conecte o sinal "pll_dqs_ena_clk" ao Núcleo IP uniphy escravo.
2. Certifique-se de que você conectou "mem_cs_n" a E/S de alto nível.
3. Os arquivos QIP das interfaces mestras devem aparecer antes dos escravos no QSF do projeto.
Este problema foi corrigido no software Quartus II versão 10.1 e posterior.