ID do artigo: 000075391 Tipo de conteúdo: Instalação e configuração Última revisão: 09/06/2017

Por que a elaboração do exemplo de Nios DE IP JESD204B falha, com uma configuração de L=1?

Ambiente

    Intel® Quartus® Prime Standard Edition
    JESD204B Intel® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

A elaboração de um exemplo de projeto de controle Nios de Arria® 10 JESD204B com L=1 pode falhar no Quartus® Prime Standard versão 17.0 devido a um problema com a interconexão de Qsys com a interface reconfig_*, resultando em Qsys não gerando os arquivos de código fonte.

Outras variantes de exemplo de design DE IP JESD204B, incluindo controle de Nios com L>1, controle de máquina de estado RTL, controle de Nios genérico e controle de máquina de estado RTL genérico não são afetados por este problema.

Resolução

Para resolver este problema, localize e faça backup de uma cópia do seguinte arquivo TCL em seu diretório de instalação Quartus Prime:

ip/altera/altera_jesd204/src/lib/phy_adapter/altera_jesd204_phy_adapter_xs_hw.tcl

• Abra o arquivo TCL com editor de texto. Procure por procedimentos xseries_avmm_adapter.

• Adicione $d_L == 1 OU verificação de condição na instrução se abaixo no procedimento xseries_avmm_adapter. Haverá 3 ocorrências das declarações se no procedimento:

Antes de mudar:

se {[param_is_true RECONFIG_SHARED]

Após a alteração:

se {[param_is_true RECONFIG_SHARED || $d_L == 1}

• Salve o arquivo TCL modificado.

• Relembe o software Quartus Prime, crie um novo projeto ou rea abra um projeto existente e gere o exemplo de projeto Arria 10 JESD204B.

Este problema está programado para ser corrigido em uma versão futura do software Quartus Prime.

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