ID do artigo: 000075437 Tipo de conteúdo: Solução de problemas Última revisão: 24/04/2017

Por que o meu Intel Arria 10 Hard IP para PCI Express não envia conjuntos ordenados TS1 ou EIOS e não indica link para baixo, na entrada para o estado desabilitado?

Ambiente

  • Hard IP para PCI Express* Intel® Arria® 10 Cyclone® 10
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    Devido a um problema com o Intel® Arria® 10 Hard IP para PCI Express®, você não verá conjuntos ordenados TS1 ou EIOS quando o LTSSM entrar no estado desabilitado. O sinal dl_up também não desafirmou no estado desabilitado.

    Resolução

    Este problema não está programado para ser corrigido em qualquer versão futura do software Quartus® Prime. Como solução alternativa, você pode ignorar o sinal dl_up quando o LTSSM estiver no estado desabilitado.

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    Este artigo aplica-se a 1 produtos

    FPGAs Intel® Arria® 10 e FPGAs SoC

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