Não, os scripts de simulação cadence* Xcelium* não são gerados para um design de exemplo de Intel® FPGA IP interlaken de 50G com Intel® Arria® 10 dispositivos. Os scripts são gerados para simular o testbench de design de Intel® FPGA 50G interlaken em Modelsim*, NCSim* e VCS* ao segmentar um dispositivo Intel Arria 10.
Os scripts de simulação cadence* Xcelium* são criados quando um design de exemplo de Intel® FPGA IP interlaken 50G é gerado para Intel® Arria® 10 dispositivos?
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