ID do artigo: 000075761 Tipo de conteúdo: Mensagens de erro Última revisão: 27/08/2013

Aviso: nenhuma célula lógica de remapeamento encontrada para PLL <pll_name> com reconfiguração dinâmica não-fase habilitada</pll_name>

Ambiente

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

Você receberá esta mensagem de aviso se você habilitar as portas de reconfiguração dinâmicas na megafunção ALTPLL sem implementar a ALTPLL_RECONFIG megafunção.

Ao usar a megafunção ALTPLL, o software Quartus® II tentará fazer o melhor roteamento para saídas de contador PLL com base nos requisitos específicos de recursos de projeto. Por exemplo, C0 pode ser remapped para C3. Se a ALTPLL_RECONFIG megafunção for implementada, o remapeamento do contador será feito automaticamente e será transparente para o usuário.

Se você não estiver usando a megafunção de ALTPLL_RECONFIG, use a atribuição 'Preservar o contra-pedido PLL' pode ser usada para impedir que o contador de saída (s) seja remapeada.

Você pode seguir a sequnece abaixo para otimizar os contadores de saída PLL para o seu design:

1. Compile o projeto e verifique o relatório do compilador para ver qual contador está conectado à saída do clock.
2. Modifique a conexão de saída do clock PLL em seu RTL para corresponder ao pedido (conforme indicado no relatório de uso do PLL).
Por exemplo: se você ver clkout0 àSPAN> contador 3, em seguida, mova todas as conexões de saída do clockout0 para clkout3, faça isso para todas as outras saídas de clock.
3. Compile o projeto novamente, desta vez com "Preserve PLL Counter Order" definido como ON para o PLL no Editor de Atribuição.

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