UG-20160 | versões 2020.06.29 e anteriores indicam que o arquivo .regmap será criado ao gerar o Hard IP de Stratix® 10 E-Tile para Ethernet Intel® FPGA IP e E-Tile CPRI PHY IP Core. Isso está incorreto. O arquivo .regmap não é gerado.
Este erro foi removido da tabela Arquivos gerados pelo IP Core , atualizado para a versão 20.2 do Intel® Quartus® Prime Design Suite.