ID do artigo: 000076360 Tipo de conteúdo: Solução de problemas Última revisão: 14/09/2017

Qual é o tamanho máximo de carga que eu posso emitir o PCI Express Hard IP na interface Avalon-ST TX?

Ambiente

    Intel® Quartus® II Subscription Edition
    PCI Express*
    Hard IP para PCI Express* Intel® Arria® 10 Cyclone® 10
    Hard IP para PCI Express* Arria® V GZ Intel® FPGA IP
    Hard IP para PCI Express* Arria® V Intel® FPGA IP
    Intel® Stratix® 10 Hard IP para PCI Express* Avalon-ST
    Hard IP para PCI Express* Cyclone® V Intel® FPGA IP
    IP_Compiler para PCI Express*
    Hard IP para PCI Express* Stratix® V Intel® FPGA IP
    Hard IP para PCI Express* com SR-IOV Stratix® V Intel® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

No modo Avalon-ST, a lógica do usuário é necessária para garantir que o TLP TX apresentado ao núcleo PCI* Express IP não seja maior do que o tamanho de carga máxima negociada.

 

 

Resolução

Certifique-se de que aTLP TX apresentada ao núcleo PCI* Express IP não seja maior do que o tamanho de carga máxima negociada.

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