ID do artigo: 000077235 Tipo de conteúdo: Solução de problemas Última revisão: 28/06/2012

Não é possível gerar DDR3 RDIMM IP para Stratix IV ou Stratix V com RC8RC15 definido como valores não zero

Ambiente

    Intel® Quartus® II Subscription Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT

Problema crítico

Descrição

Este problema afeta os produtos DDR3.

Se você especificar um valor não zero para qualquer um dos campos RC8-RC15 da palavra de controle DDR3 RDIMM, a geração IP falha com o seguinte Erro:

Error: integer value too large to represent.

Resolução

A solução alternativa para este problema é modificar o código no uniphy_gen.tcl arquivo. Siga estas etapas:

  1. No diretório ip/altera/alt_mem_if/alt_mem_if_tcl_packages/gen/� , abra o uniphy_gen.tcl arquivo em um editor.
  2. No arquivo uniphy_gen.tcl , procure o seguinte comentário de texto:
# Need to split the 64-bit RDIMM configuration word into 2 32-bit words for the sake of C-code�
  • No local do comentário de texto, substitua o seguinte código existente:
  • if {([string compare -nocase "DDR3"] == 0) && } { # Need to split the 64-bit RDIMM configuration word into 2 32-bit words for the sake of C-code set rdimm_config_dec [ expr 0x[get_parameter_value RDIMM_CONFIG] ] set rdimm_config_high [ format "0x%X" [ expr >> 32 ] ] set rdimm_config_low [ format "0x%X" [ expr & 0xFFFFFFFF ] ] append sw_macros " -DRDIMM_CONFIG_WORD_LOW=" append sw_macros " -DRDIMM_CONFIG_WORD_HIGH=" }

    com o seguinte novo código:

    if {([string compare -nocase "DDR3"] == 0) && } { # Need to split the 64-bit RDIMM configuration word into 2 32-bit words for the sake of C-code set rdimm_config_str [ get_parameter_value RDIMM_CONFIG ] set rdimm_config_low "0x[ string range end-7 end ]" # Handle two halves of 16-byte string independently if {([string length ] > 8)} { set rdimm_config_high "0x[ string range end-15 end-8 ]" } else { set rdimm_config_high "0x0" } append sw_macros " -DRDIMM_CONFIG_WORD_LOW=" append sw_macros " -DRDIMM_CONFIG_WORD_HIGH=" }

    Este problema será corrigido em uma versão futura.

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Este artigo aplica-se a 2 produtos

FPGAs Stratix® IV
FPGAs Stratix® V

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