ID do artigo: 000077400 Tipo de conteúdo: Solução de problemas Última revisão: 12/08/2019

Por que as configurações de equalização do meu Intel® Stratix® E-Tile Native PHY IP TX de 10 dispositivos não combinam com o que é lido do registro de atributos PMA ou o que é exibido no kit de ferramentas do transceptor de software Intel Q...

Ambiente

    Intel® Quartus® Prime Pro Edition
    Transceptor PHY nativo do bloco E Stratix® 10
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

Devido a um problema na versão 19.2 do software Prime de Intel® Quartus® e anterior, as configurações de equalização nativas de Stratix 10 dispositivos definidos pelo usuário podem não ser incorporadas corretamente no arquivo de programação <project_name>.sof.

As seguintes condições podem fazer com que as configurações de equalização TX não serão escritas no arquivo <project_name>.sof

  • Atenuação sem suporte, pré-toque 1, pré-toque 2, configurações de equalização pré-toque 3 ou pós-toque 1.
  • Um valor ATTEN não zero.

As configurações de equalização lidas no registro de atributos PMA ou exibidas no kit de ferramentas do transceptor prime Intel Quartus representam as configurações de equalização reais no PHY.

Resolução

Para resolver este problema, consulte o Guia do usuário do transceptor E-Tile PHY e insira apenas as configurações de equalização TX suportadas no IP nativo de E-Tile.

Se você quiser usar configurações de equalização TX não-zero, escreva para o PHY usando os códigos de atributos PMA após a configuração FPGA configuração.

Este problema foi corrigido no Intel® Quartus® versão 19.3 do software

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Este artigo aplica-se a 2 produtos

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FPGA Intel® Stratix® 10 MX

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