ID do artigo: 000077540 Tipo de conteúdo: Solução de problemas Última revisão: 28/02/2013

Por que eu recebo erros de ajuste ao compilar um projeto de controlador baseado em DDR3 UniPHY no Designer de plataforma?

Ambiente

    Intel® Quartus® II Subscription Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

Você pode ver os seguintes erros ao tentar compilar o design do HPS gerado no Designer de plataforma:

Erro: a porta de entrada DATAIN no átomo ".config_1", que é uma cyclonev_io_config primitiva, não está conectada legalmente e/ou configurada
Informações (129003): DATAIN da porta de entrada é impulsionado por um sinal constante, mas o compilador espera que esta porta de entrada esteja conectada a um sinal real
Erro: A porta de entrada ENA no átomo ".config_1", que é uma cyclonev_io_config primitiva, não está conectada legalmente e/ou configurada
Informações (129003): A porta de entrada ENA é orientada por um sinal constante, mas o compilador espera que esta porta de entrada esteja conectada a um sinal real
Erro: Atualização da porta de entrada no átomo ".config_1", que é um cyclonev_io_config primitivo, não está conectado legalmente e/ou configurado
Informações (129003): A ATUALIZAÇÃO da porta de entrada é conduzida por um sinal constante, mas o compilador espera que esta porta de entrada esteja conectada a um sinal real

 

Resolução

Isso acontece quando você usa o Designer de plataforma diretamente através da geração diferida. Por exemplo, seu arquivo .qsf inclui o arquivo .qsys e a propriedade intelectual (IP) é gerada em tempo real. Isso não funciona em uma versão atual do software Quartus II.

O fluxo de projeto correto é substituir o arquivo .qsys em sua lista de arquivos de projeto pelo arquivo .qip e depois recompilar seu design.

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