ID do artigo: 000077992 Tipo de conteúdo: Solução de problemas Última revisão: 11/09/2012

Erro de sintaxe HDL verilog: erro de sintaxe próximo ao final do arquivo?

Ambiente

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição The Quartus®As versões de software II 2.1 e acima da Ajuda indicam algumas possíveis causas deste erro de sintaxe. Este erro também pode ocorrer no software Quartus II se você usar um comando /* translate_off */ com um comando // translate_on.

No HDL verilog, você pode indicar comentários usando // ou /* */ . No software Quartus II versão 2.1, se você usar a sintaxe /* síntese translate_off */ , você também deve usar a síntese de /* translate_on */ não // síntese translate_on . Esta restrição foi removida no software Quartus II versão 3.0. O software Quartus II suporta as seguintes diretrizes diferentes do compilador de tradução:

Verilog HDL:



// synthesis translate_off   // synthesis translate_on 



or



/* synthesis translate_off */ /* synthesis translate_on */



VHDL:



-- synthesis translate_off -- synthesis translate_on

Além da palavra-chave síntese mostrada acima, as seguintes palavras-chave são suportadas tanto no HDL Verilog quanto no VHDL para compatibilidade com outras ferramentas de síntese:

pragma       

synopsys     

exemplar

NOTA: As versões 2.0 e abaixo do software Quartus II não suportam as diretrizes do compilador. Você verá comportamento diferente no software Quartus II se os designs compilados em versões anteriores do software incluíram essas diretrizes. Você pode precisar alterar seu código agora que as opções são honradas pelo software, uma vez que as versões anteriores do Compilador Quartus II trataram as opções como apenas comentários.

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