ID do artigo: 000079429 Tipo de conteúdo: Solução de problemas Última revisão: 15/11/2011

Clock mem_cq_n não usado para interfaces QDR em Arria V e Cyclone V

Ambiente

    Intel® Quartus® II Subscription Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT

Problema crítico

Descrição

Em controladores SRAM QDR II e QDR II com segmentação UniPHY Arria dispositivos V ou Cyclone V, com latência de leitura não igual a 2, o clock de cortesia mem_cq_n não é usado para captura, portanto, o pino não é usado.

Nos casos em que a latência de leitura é igual a 2, mem_cq_n serve como o relógio de captura e mem_cq não é usado.

Este problema afeta os controladores SRAM QDR II e QDR II Arria V e Cyclone V, onde a latência de leitura não é igual a 2.

Resolução

Não há solução alternativa para este problema.

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Este artigo aplica-se a 2 produtos

FPGAs Arria® V e FPGAs SoC
FPGAs Cyclone® V e FPGAs SoC

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Isenção de responsabilidade

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