Devido a um problema no software Quartus® II versão 10.1 SP1 e posterior, as PLLs phaseclock_select Stratix® IV que compartilham uma porta comum podem ser incorretamente mescladas, mesmo que as portas restantes das duas PLLs não sejam comuns.
Este problema pode levar a problemas funcionais na simulação e no hardware no nível do portão.
Para resolver este problema, desligue a configuração de ajuste de PLLs de mesclagem automática que impede o software Quartus II de fundir as PLLs.
Este problema está programado para ser resolvido em uma versão futura do software Quartus II.