ID do artigo: 000080229 Tipo de conteúdo: Solução de problemas Última revisão: 18/06/2012

Arria V e Cyclone V de controlador de memória rígido V podem não funcionar corretamente para interfaces com 2 seleções de chip

Ambiente

  • Intel® Quartus® II Subscription Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Problema crítico

    Descrição

    Este problema afeta DDR2 e DDR3, LPDDR2, QDR II e RLDRAM Produtos II.

    Em Arria V e Cyclone V, opções de controlador de memória dura para atualização do usuário, atualização automática ou reposição profunda de energia pode não funcionar corretamente para interfaces com duas seleções de chip. Este problema pode fazer com que a simulação seja travada, e em alguns casos pode resultar em hardware Falha.

    Resolução

    A solução alternativa para este problema é editar o arquivo RTL altera_mem_if_hard_memory_controller_top_arriav.sv (para Arria V) ou altera_mem_if_hard_memory_controller_top_cyclonev.sv (para Cyclone V) e mude as seguintes linhas:

    .localrefreshchip ( local_refresh_chip ), .localdeeppowerdnreq ( local_deep_powerdn_req ), .localdeeppowerdnchip ( local_deep_powerdn_chip ), .localselfrfshreq ( local_self_rfsh_req ), .localselfrfshchip ( local_self_rfsh_chip ),

    Para:

    .localrefreshchip ( local_refresh_chip_wire ), .localdeeppowerdnreq ( local_deep_powerdn_req ), .localdeeppowerdnchip ( local_deep_powerdn_chip_wire ), .localselfrfshreq ( local_self_rfsh_req ), .localselfrfshchip ( local_self_rfsh_chip_wire ),

    Este problema será corrigido em uma versão futura.

    Produtos relacionados

    Este artigo aplica-se a 2 produtos

    FPGAs Cyclone® V e FPGAs SoC
    FPGAs Arria® V e FPGAs SoC

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