ID do artigo: 000081553 Tipo de conteúdo: Documentação e informações do produto Última revisão: 01/01/2015

Como calcular a frequência, o deslocamento de fase e o ciclo de trabalho para clock de SERDES suaves ALTLVDS usando o modo PLL externo?

Ambiente

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

Altera® dispositivos têm dois tipos de implementação para blocos SERDES - SERDES rígidos e SERDES macios (construídos a partir de células lógicas).  Este documento discutirá como calcular a frequência, o deslocamento de fase e o ciclo de trabalho para cada um dos clocks necessários para a interface PLL externa com SERDES suaves. Ao selecionar o modo PLL externo, você deve definir os parâmetros PLL, mas você pode acessar outros recursos do PLL, como comutação de clock, reconfiguração PLL e outros clocks de saída que de outra forma não estariam disponíveis ao usar o PLL interno.

Baixe este documento de como fazer para saber como você pode calcular a frequência, o deslocamento de fase e o ciclo de trabalho para cada um dos clocks usados para o modo PLL externo com SERDES macios.

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