Você pode ver este erro nas versões 13.0 e 13.1 do software Quartus® II ao usar soCs Arria® V ou Cyclone® V. Este erro ocorre quando você usa os pinos de E/S do Sistema de processador rígido (HPS) e instanciona uma Intel® FPGA IP ALTLVDS no design FPGA de armazenamento.
Este não é um erro válido; não há dependências de recursos entre os pinos de E/S hps e os pinos de E/S FPGA E/S.
Baixe o patch a seguir para corrigir este erro para o software Quartus II versão 13.1:
- Versão 13.1 do patch 0.15 para Windows (.exe)
- Versão 13.1 do patch 0.15 para Linux (.tar)
- Leiame para o software Quartus II versão 13.1 patch 0.15 (.txt)