Este erro pode ser visto durante a simulação de megafunções PLL Altera geradas em VHDL a partir do software Quartus® II versão 12.1, quando os parâmetros do clock de saída de phisical são habilitados no MegaWizard™ e um Fator de multiplicação fracionada (k) foi especificado.
Para resolver esse problema no software Quartus II versão 12.1, as megafunções PLL Altera PLL devem ser geradas no Verilog se a configuração manual do Fator multiplicador fracionário (k) for necessária.
Este problema está programado para ser corrigido em uma versão futura do software Quartus II.