ID do artigo: 000085865 Tipo de conteúdo: Solução de problemas Última revisão: 13/02/2014

Quais são as frequências mínimas de clock de memória suportadas pelo IP da interface de memória externa UniPHY?

Ambiente

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

As frequências mínimas são definidas pelo padrão JEDEC® relevante ou pelos recursos componentes do dispositivo FPGA usado para implementar o IP da interface de memória externa.

Se um valor de frequência muito baixo for inserido na guia Configurações do PHY UniPHY IP -> frequência do clock de memória, ele será exibido em vermelho. A seguinte mensagem de erro é mostrada na janela de mensagem IP indicando a frequência mais baixa suportada:

Erro: a frequência de clock de memória especificada está abaixo do mínimo definido pela especificação DDR. Selecione uma frequência maior ou igual a 300 MHz.

Para obter uma estimativa da frequência máxima suportada para qualquer configuração de protocolo de dispositivo e memória, use a ferramenta Estimador de especificações de interface de memória externa.

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