ID do artigo: 000086345 Tipo de conteúdo: Solução de problemas Última revisão: 07/07/2021

Por que a Intel® Stratix® 10 FPGA não é configurada ao programar um arquivo .jic?

Ambiente

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    Devido a um problema no software Intel® Quartus® Prime Pro Edition versão 21.1, um arquivo .jic inválido será gerado quando frequências incompatíveis são usadas para ACTIVE_SERIAL_CLOCK e DEVICE_INITIALIZATION_CLOCK em seu Arquivo de configurações Quartus (.qsf). O fluxo de configuração falhará usando este arquivo .jic.

    Resolução

    Para evitar esse erro, certifique-se de que seu arquivo .qsf tenha um conjunto compatível de frequências para ACTIVE_SERIAL_CLOCK e DEVICE_INITIALIZATION_CLOCK. As configurações AS_CLK válidas podem ser encontradas no Guia do usuário de configuração Intel® Stratix® 10.

     

    Um patch está disponível para verificar as frequências válidas de ACTIVE_SERIAL_CLOCK e DEVICE_INITIALIZATION_CLOCK no Arquivo de configurações Quartus (.qsf).

    Baixe e instale o Patch 0.06 no link abaixo.

    > patch de download Intel® Quartus® Prime Pro Edition 21.1 patch 0.06 para Windows (.exe)

    > patch de download Intel® Quartus® Prime Pro Edition 21.1 patch 0.06 para Linux (.run)

    > o Readme para Intel® Quartus® Prime Pro Edition 21.1 patch 0.06 (.txt)

    Após instalar o patch 0.06, em sua próxima compilação com um conjunto incompatível de frequências, você receberá uma mensagem de erro durante o estágio de montagem dizendo : "O clock serial ativo não é suportado no clock de inicialização do dispositivo"

     

    Este problema é corrigido a partir do software Intel® Quartus® Prime Pro Edition versão 21.2.

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    Este artigo aplica-se a 1 produtos

    FPGAs Intel® Stratix® 10 e FPGAs SoC

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