ID do artigo: 000086659 Tipo de conteúdo: Solução de problemas Última revisão: 24/06/2021

Por que o tempo de configuração de periferia de configuração via protocolo (CvP) está excedendo o requisito de tempo de inicialização ativa de PCIe de 100 ms?

Ambiente

  • Intel® Quartus® Prime Pro Edition
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    No Intel® Quartus® Software Prime Pro Edition versão 21.2, o link PCIe CvP pode não conseguir enumerar corretamente com Intel Agilex® 7 dispositivos. Isso ocorre porque o tempo de configuração da imagem de periferia excede o requisito de tempo de inicialização para ativo do PCIe de 100 ms.

    Resolução

    Para contornar esse problema, reenviar o link PCIe depois que o FPGA for configurado com sucesso.

    Este problema é corrigido na Intel® Quartus® Software Prime Pro Edition versão 21.3.

    Produtos relacionados

    Este artigo aplica-se a 2 produtos

    FPGAs e FPGAs SoC Intel® Agilex™ série F
    FPGAs e FPGAs SoC Intel® Agilex™ 7 série I

    Isenção de responsabilidade

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