ID do artigo: 000086766 Tipo de conteúdo: Solução de problemas Última revisão: 20/07/2021

Por que a configuração de mudança de fase do estroma de captura para o PHY Lite para interfaces paralelas Intel FPGA IP fixa em 90 graus?

Ambiente

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    Devido a um problema no software Intel® Quartus® Prime Pro Edition versão 21.1, pode haver uma falha no teste de hardware relacionada à configuração de mudança de fase do estroma de captura para o PHY Lite for Parallel Interfaces Intel FPGA IP em todas as frequências suportadas ao atingir o dispositivo Intel® Agilex® 7. A falha no teste de hardware pode ser observada quando a mudança de fase de estrobosto de captura estiver definida como:

    - Qualquer valor para frequências de interface menores que 150 MHz.

    - Qualquer valor que não seja de 90 graus para frequências de interface de 150 MHz ou mais.

    Devido a essa falha, as frequências de interface abaixo de 150 MHz não são suportadas no PHY Lite para interfaces paralelas Intel FPGA IP. A frequência mínima da interface deve ser de 150 MHz.

    Para as frequências de interface suportadas, a mudança de fase do estrobosto de captura é fixa em 90 graus no PHY Lite para interfaces paralelas Intel FPGA IP GUI.

    Resolução

    Para o software Intel® Quartus® Prime Pro Edition versão 21.1 e mais recente, é recomendável usar valores de mudança de fase de estrobosto de captura diferentes de 90 graus para usar reconfiguração dinâmica.

    Para obter mais detalhes, consulte PHY Lite for Parallel Interfaces Intel® FPGA IP User Guide, seção reconfiguração dinâmica.

    Para as versões 20.4 e 20.3 do software Intel Quartus® Prime Pro Edition, não há suporte de hardware habilitado para PHY Lite para interfaces paralelas Intel Agilex® 7 FPGA IP.

    Outras informações

    Este problema é corrigido a partir do software Intel® Quartus® Prime Pro Edition versão 21.3.

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