ID do artigo: 000093130 Tipo de conteúdo: Solução de problemas Última revisão: 07/11/2023

Por que as loops estão sendo relatadas em memórias que são implementadas em MLABs?

Ambiente

    Intel® Quartus® Prime Pro Edition
BUILT IN - ARTICLE INTRO SECOND COMPONENT

Problema crítico

Descrição

Devido a um problema na versão 22.3 ou anterior do software Intel® Quartus® Prime Pro, você pode ver loops sendo relatados para memórias que contêm a funcionalidade de habilitação de leitura que estão sendo implementadas em MLABs por um dos seguintes métodos de relatórios:

  • Avisos "Found combinational loop of * nodes" no relatório do Analisador de temporização.
  • "LNT-30011 - Design contém violações de regras de loops combinados" no relatório do Design Assistant (sintetizado).
  • "TMC-20017 - Loops Detectou" violações das regras no relatório do Design Assistant (Signoff).
  • "Loops" reportado ao executar o relatório "check_timing" no Analisador de temporização.
  • "Nó: * foi determinado que era um clock, mas foi encontrado sem uma atribuição de clock associada." aviso no relatório do Analisador de temporização.

As loops relatadas resultam de uma trava sendo implementada na saída do MLAB para suportar a funcionalidade de habilitação de leitura. Esta trava não é analisada corretamente por tempo, o que significa que a funcionalidade não pode ser garantida no hardware.

Esse problema pode ocorrer para os seguintes estilos de implementação de memória, que são colocados em blocos de memória MLAB:

  1. Código RTL que infere diretamente uma memória contendo funcionalidade de habilitação de leitura.
  2. Instanciação direta da memória, incluindo a funcionalidade de ativação de leitura e uma configuração ram_block_type do MLAB ou AUTO
Resolução

Para contornar esse problema, faça um dos seguintes:

Esse problema está programado para ser corrigido em uma versão futura do software Intel® Quartus® Prime Pro Edition.

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