Esse erro será visto ao usar o Questa*-Intel® FPGA Edition para simular o exemplo de projeto do Intel Agilex® 7 série M FPGA EMIF IP para interfaces DDR5.
Para contornar esse problema, execute as seguintes etapas:
- Abra o arquivo msim_setup.tcl na pasta .../sim/ed_sim/mentor.
- Modifique o seguinte comando:
eval vsim -suppress 2732 -suppress 1130 -suppress 7041 -suppress 7033 $elabcommand
Para
eval vsim -nocvg -suppress 2732 -suppress 1130 -suppress 7041 -suppress 7033 $elabcommand