VHDL: ROM de porta única

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Este exemplo descreve um projeto de ROM de 256 bits x 8 bits de porta única com uma porta de endereço para operações de leitura em VHDL. As ferramentas de síntese são capazes de detectar designs de ROM no código HDL e inferir automaticamente as megafunções altsyncram ou lpm_rom dependendo da arquitetura do dispositivo de destino.

Figura 1. Diagrama de rom de nível superior de uma única porta

Baixe os arquivos usados neste exemplo:

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