ID do artigo: 000073756 Tipo de conteúdo: Solução de problemas Última revisão: 10/10/2013

Por que a simulação de exemplo de projeto falha quando o controlador UniPHY é gerado apenas com a opção PHY?

Ambiente

  • Software Intel® Quartus® II
  • Controlador SDRAM DDR3 com UniPHY Intel® FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    Ao simular o projeto de exemplo de um controlador UniPHY com opção apenas PHY, algumas portas na instância *_e0_c0 do controlador não são conectadas, provocando falha na simulação.

    Resolução

    A solução alternativa é vincular todas as portas de entrada desconectadas a zero na instância *_example_sim_e0_c0 do arquivo *_e0.v.

    Este problema foi corrigido na versão 13.1 do software Quartus® II.

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