Problema crítico
Este problema afeta produtos LPDDR2.
Projetos LPDDR2 destinados Cyclone dispositivos V a 300 MHz ou 333 MHz falhará no hardware devido a uma configuração de bits do controlador de memória dura incompatibilidade no arquivo de objetos SRAM (.sof).
A solução alternativa para este problema é executar projetos LPDDR2 com controlador de memória dura Cyclone dispositivos V a 200 MHz ou 267 MHz em vez de 300 MHz ou 333 MHz. Se você estiver usando um LPDDR2-S4 dispositivo de memória, altere o valor do tCCD de 1 para 2.
Este problema é corrigido na versão 12.1 SP1 DP1.