Sim, devido a um problema nas versões do software Intel® Quartus® Prime Pro Edition 17.1 e anteriores, a E/S 3V em Intel® Stratix® 10 FPGAs pode impulsionar uma alta alta durante a configuração quando os pinos são atribuídos como saídas no seu design compilado.
Esse comportamento não é visto quando a E/S 3V é atribuída como entradas ou E/S bidirecional.
Esses E/S de 3V estão localizados em bancos de E/S 6A, 6B, 6C, 7A, 7B, 7C, e estão disponíveis em diferentes densidades e variantes de pacote de Intel Stratix 10 dispositivos.
Este problema está programado para ser corrigido em uma versão futura do software Intel Quartus Prime Pro Edition.