Sim, devido a um problema conhecido no software Intel® Quartus® Prime Pro Edition versão 17.1 da atualização 2 ou anterior, quando a E/S 3V no Intel® Stratix® 10 FPGAs é atribuída a um GND estático no design, você pode ver uma inversão no pino de saída.
Os E/S de 3V estão localizados em bancos de E/S 6A, 6B, 6C, 7A, 7B, 7C, e estão disponíveis em diferentes densidades e variantes de pacote de Intel® Stratix® 10 dispositivos.
Para resolver isso, use uma entrada para conduzir a E/S de 3V ou coloque a atribuição do sinal em um processo com clock.
Isso está programado para ser corrigido em uma versão futura do software Intel® Quartus® Prime Pro Edition.