Problema crítico
O local do buffer do clock DQS para o UniPHY pode causar a espera violações de tempo quando colocadas subotimicamente. O software Quartus II pode colocar subotimicamente o buffer do clock DQS em um global ou dual-regional clock após a reinstalação do FPGA, para que ele possa ser encaminhado para o lado de gravação do buffer de captura de leitura FIFO.
Crie uma atribuição de local no buffer para a mesma borda
como a interface de memória (por exemplo EDGE_BOTTOM
).