ID do artigo: 000078097 Tipo de conteúdo: Solução de problemas Última revisão: 04/03/2013

Por que meu arquivo de netlist Verilog do Compilador de design falha na compilação do Quartus II?

Ambiente

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

O software Quartus® II não suporta oficialmente a importação de netlists Verilog geradas a partir do Compilador de design de sinopse.

 

O software Quartus II pode gerar erros durante a compilação quando o Compilador de design é definido como a ferramenta de síntese e o arquivo de mapeamento da biblioteca (.lmf) é especifado por meio do menu De configurações de ferramentas EDA.

 

Para resolver este problema, defina o arquivo de mapeamento da biblioteca altsyn.lmf seguindo estas etapas:

  1. Escolha Configurações no menu Atribuições.
  2. Em Configurações de análise e síntese, escolha Verilog HDL Input.
  3. Insira o caminho para o arquivo de mapeamento da biblioteca altsyn.lmf na caixa Arquivo de mapeamento da biblioteca.

O arquivo altsyn.lmf pode ser encontrado no diretório de instalação quartus II: caminho de instalação <Quartus II>\quartus\lmf.

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