Você pode experimentar o erro de ajuste acima ao compilar um controlador de memória baseado no UniPHY no Quartus® II versão 12.1. O erro ocorre porque não há recursos de roteamento de clock dedicados entre as duas PLLs.
A solução alternativa é inserir um buffer de clock (altclkctrl) entre a entrada pll_ref_clk e as PLLs.