A FPGA JTAG não requer uma fonte de clock externa além do clock TCK. No entanto, o HPS JTAG requer uma fonte de clock externa derivada do pino EOSC1. A Porta de acesso de depuração (DAP) usa a dbg_clk gerada a partir do clock ao controlar o HPS JTAG.
Para resolver este problema, certifique-se de que o pino EOSC1 tenha uma fonte de clock externa e defina o gerenciador de clock para fornecer o dbg_clk para o DAP.