ID do artigo: 000083091 Tipo de conteúdo: Solução de problemas Última revisão: 15/06/2018

Por que meu Intel® FPGA PCIe* IP não pode vincular o trem em alguns sistemas?

Ambiente

  • DMA para PCI Express* Avalon-MM série V
  • Hard IP para PCI Express* Intel® Arria® 10 Cyclone® 10
  • Hard IP para PCI Express* Arria® V Intel® FPGA IP
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  • Hard IP para PCI Express* Avalon-MM Stratix® V Intel® FPGA IP
  • Intel® Stratix® 10 Hard IP para PCI Express* Avalon-ST
  • Intel® Stratix® 10 Hard IP para PCI Express* Avalon-MM
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    Os sinais da placa PCIe* Presente (PRSNT1_N, PRSNT2_N_X1, PRSNT2_N_X4, PRSNT2_N_X8, PRSNT2_N_X16) precisam ser definidos corretamente em alguns sistemas de host inteligentes ou o Link PCIe* pode não treinar corretamente.

    Por exemplo, alguns sistemas só tentam vincular o treinamento ao número de vias indicadas pelos sinais atuais para esse slot. Portanto, se nenhum dos sinais atuais estiver habilitado, a placa pode não treinar de forma nenhuma, ou se, por exemplo, apenas o sinal atual x1 estiver habilitado, então uma implementação x4, x8 ou x16 só poderá ser treiná-lo como uma configuração de interface x1.

    Resolução

    Este problema depende do sistema host e do BIOS. Alguns sistemas ignoram esses sinais. Certifique-se de que os sinais PRSNT estejam correclty habilitados para hardware, ao usar Intel® FPGA Development Kits, os sinais PRSNT são tipicamente selecionáveis usando um comutador DIP.

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