ID do artigo: 000085162 Tipo de conteúdo: Solução de problemas Última revisão: 11/09/2012

Por que o analisador de sincronização timeQuest gera frequências de clock de saída PLL incorretas após executar o comando derive_pll_clocks comando?

Ambiente

    Intel® Quartus® II Subscription Edition
    PLL
BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrição

Devido a um problema no software Quartus® II versão 11.1 SP2 e anterior, derive_pll_clocks o comando no analisador de tempo do TimeQuest pode gerar clocks com frequências incorretas para determinadas configurações de PLL. Este problema afeta os projetos que Arria® dispositivos V, Cyclone® V e Stratix® V.

Se o derive_pll_clocks comando for usado com a opção -create_base_clocks , a frequência do clock de entrada pode ser metade da frequência correta. Se o clock de entrada tiver sido definido pelo usuário, os clocks de saída PLL podem ser o dobro da frequência correta.

Este problema afeta apenas a análise de tempo. O PLL implementado no dispositivo tem os fatores corretos de multiplicação ou divisão.

Resolução

Se a implementação do PLL tiver o problema descrito, restrite manualmente seus clocks PLL. Substitua o comando derive_pll_clocks por create_clock e create_generated_clock comandos.

Este problema é corrigido a partir da versão 12.0 do software Quartus II.

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