ID do artigo: 000086802 Tipo de conteúdo: Documentação e informações do produto Última revisão: 28/09/2018

Como os dados armazenados nos dados de leitura FIFO no Intel® Stratix® 10 serial Flash Mailbox Client Intel® FPGA IP núcleo são lidos com um host JTAG?

Ambiente

  • Intel® Quartus® Prime Pro Edition
  • Cliente de caixa de correio Intel® Stratix® 10 FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrição

    Os dados de leitura FIFO podem ser acessados através do barramento "rd_mem" no Intel® Stratix® 10 Serial Flash Mailbox Client Intel® FPGA IP core. Para ler os dados armazenados nos dados de leitura FIFO, você precisa ler os dados do barramento "rd_mem". Consulte a base e o endereço final rd_mem IP no Designer de plataforma para obter o endereço inicial e a lista de endereços que você pode ler.

    Para obter mais detalhes sobre o fluxo de operação de leitura, consulte Stratix® 10 Serial Flash Mailbox Client Intel® FPGA IP Guia do usuário principal.

     

    Resolução

    Para obter mais detalhes sobre o fluxo de operação de leitura, consulte Stratix® 10 Serial Flash Mailbox Client Intel® FPGA IP Guia do usuário principal.

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    Este artigo aplica-se a 1 produtos

    FPGAs Intel® Stratix® 10 e FPGAs SoC

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    1

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